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TSB12LV41 데이터시트(PDF) 4 Page - Texas Instruments |
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TSB12LV41 데이터시트(HTML) 4 Page - Texas Instruments |
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4 / 195 page  iv 3.4 Asynchronous Transmit (Host Bus to TSB12LV41) 3–32 . . . . . . . . . . . . . . . . . . . . . . . 3.4.1 Quadlet Transmit 3–32 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3.4.2 Block Transmit 3–33 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3.4.3 Quadlet Receive 3–34 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3.4.4 Block Receive 3–36 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3.5 Isochronous Transmit and Receive (Host Bus to ’12LV41) Data Formats 3–38 . . . . 3.5.1 Isochronous Transmit 3–38 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3.5.2 Isochronous Receive 3–38 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3.6 Snoop 3–39 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3.7 Phy Configuration 3–40 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3.8 Receive Self-ID Packet 3–41 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4 External Interfaces 4–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.1 Bulky Data Interface (BDIF) 4–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.1.1 Introduction 4–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.1.2 Modes of the Bulky Data Interface (BDIF) 4–5 . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.2 Bulky Data Interface Timing 4–11 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.2.1 Unidirectional and Asynchronous Modes 4–11 . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.2.2 Bidirectional Modes 4–14 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3 Microprocessor Interface 4–18 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.1 Microprocessors Supported 4–18 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.2 Microprocessor Interface Control 4–21 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.3 Handshake and Blind Access modes 4–22 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.4 General Read Instructions 4–22 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.5 General Write Instructions 4–23 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.6 TMS320AV7100 Mode Timing Diagrams 4–23 . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.7 68000 Mode Timing Diagrams 4–29 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.8 8051 Mode Timing Diagrams 4–33 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.9 Blind Access Mode Specific Issues 4–37 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.10 Endianness 4–38 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.3.11 Use of Interrupts with MPEG2Lynx 4–40 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.4 TSB12LV41 to 1394 Phy Interface Specification 4–41 . . . . . . . . . . . . . . . . . . . . . . . . . . 4.4.1 Introduction 4–41 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.4.2 Assumptions 4–41 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.4.3 Block Diagram 4–41 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.4.4 Operational Overview 4–42 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.4.5 Request 4–43 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.4.6 Status 4–45 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4.4.7 TSB12LV41 to Phy Bus Timing 4–47 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5 Detailed Operation and Programmers Reference 5–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5.1 TSB12LV41 Configuration Register 5–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5.2 Version Register (VERS @ Addr 0h) 5–6 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5.3 C Acknowledge Register (CACK @ Addr 4h) 5–6 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5.4 B Acknowledge Register (BACK @ Addr 8h) 5–7 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5.5 Link Control Register (LCTRL @ Addr Ch) 5–8 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5.6 Interrupt Register/Interrupt Mask Register (IR @ Addr 10h/14h) 5–11 . . . . . . . . . . . . 5.7 Extended Interrupt Register/Extended Interrupt Mask Register (EIR @ Addr 18h/1Ch) 5–13 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . |
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